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用ISP器件设计现代电路与系统

用ISP器件设计现代电路与系统

定 价:¥26.00

作 者: 刘笃仁编著
出版社: 西安电子科技大学出版社
丛编项:
标 签: 电路设计

ISBN: 9787560611280 出版时间: 2002-01-01 包装: 平装
开本: 26cm 页数: 314 字数:  

内容简介

  本书内容包括:现代电路与系统设计;在系统编程技术与器件;高密度在系统可编程逻辑器件(ispLSI、ispMACH系列);在系统可编程模拟器件(ispPAC系列);在系统可编程数字开关及互联器件(ispGDS、ispGDX、ispGDXV系列);在系统编程软件中用到的ABEL硬件描述语言;在系统编程软件中用到的VHDL硬件描述语言;在系统编程软件中用到的Verilog硬件描述语言;新型的逻辑电路与系统设计软件ISP Design EXPERT;模拟电路设计软件PAC-Designer;数字开关及互联器件设计软件ispGDX开发系统;ISP编程下载电缆、ISP实验开发装置及编程下载;ispLSI、ispGDS、ispGDX及ispPAC等设计应用实例。本书内容取材新颖,先进实用,叙述简洁,循序渐进,主要章节经教学、科研实践证明效果很好。本书既可供电子类各专业本科生、研究生作为教材使用,也可作为电子类工程技术人员的自学参考书。

作者简介

暂缺《用ISP器件设计现代电路与系统》作者简介

图书目录

前言
第1章 现代电路与系统设计
1.1 什么是现代电路与系统
1.2 现代电路与系统的设计思想
1.3 现代电路与系统的实现手段
1.4 现代电路与系统的设计流程
第2章 ISP技术及其器件
2.1 ISP技术
2.1.1 ISP技术有利于设计
2.1.2 ISP技术有利于生产制造
2.1.3 ISP利用了先进的ECMOS工艺
2.1.4 ISP应用前景广阔
2.1.5 ISP的未来
2.2 ISP器件
2.2.1 ispMACHTM&ispLSI@
2.2.2 ispGDXTM&sipGDSTM
2.2.3 ispPACTM
2.2.4 在系统可编程逻辑器件的结构
2.2.5 在系统可编程接口与互联器件的结构
2.2.6 在系统可编程模拟器件的结构
2.3 ISP的实现
第3章 高密度在系统可编程逻辑器件
3.1 ispLSll000/E系列(1k系列)
3.1.1 功能结构
3.1.2 技术指标
3.2 ispLSI2000系列(2k系列)
3.2.1 功能结构
3.2.2 技术指标
3.3 ispLSI3000系列(3k系列)
3.3.1 功能结构
3.3.2 技术指标
3.4 ispLSI5000V系列(5k系列)
3.4.1 功能结构
3.4.2 技术指标
3.5 ispLSI6000系列(6k系列)
3.5.1 功能结构
3.5.2 特性与技术指标
3.6 ispLSI8000/V系列(8k系列)
3.6.1 功能结构
3.6.2 技术指标
3.7 ispMACHTM4A系列
3.7.1 功能结构
3.7.2 技术指标
第4章 在系统可编程模拟器件
4.1 ispPAC10
4.1.1 功能结构
4.1.2 性能指标
4.2 ispPAC20
4.2.1 功能结构
4.2.2 工作原理及有关问题说明
4.3 ispPAC30
4.4 ispPAC80
4.4.1 功能结构
4.4.2 工作原理及有关问题说明
4.4.3 性能指标
第5章 在系统可编程数字开关及互联器件
5.1 ispGDS系列器件介绍
5.2 ispGDS器件的优点及编程步骤
5.2.1 ispGDS器件的优点
5.2.2 编程步骤
5.3 ispGDS的特性与指标
5.3.1 特性
5.3.2 指标
5.4 ispGDX、ispGDXV系列器件
5.4.1 ispGDX、ispGDXV的功能结构
5.4.2 ispGDX、ispGDXV的应用领域
5.4.3 ispGDX、ispGDXV的特性及有关技术指标
第6章 在系统编程开发软件中用到的ABEL-HDL
6.1 ABEL-HDL源文件格式
6.2 编写源文件预备知识
6.3 ABEL-HDL源文件的编写
第7章 在系统编程开发软件中用到的VHDL
7.1 VHDL语言的源文件结构
7.2 编写VHDL源文件预备知识
7.2.1 VHDL基本要素
7.2.2 VHDL基本语句
7.2.3 其它一些有关知识
7.3 VHDL的层次化设计及ISP中的VHDL
第8章 在系统编程开发软件中用到的Verilog HDL
8.1 Verilog语言的源文件结构
8.2 编写Verilog源文件预备知识
8.2.1 Verilog语言基本要素
8.2.2 Verilog语言基本语句
8.2.3 Verilog的系统函数和任务
8.2.4 Verilog的编译预处理
8.3 Verilog的建模
8.4 Verilog的层次化设计及ISP中的Verilog
第9章 ISP Design EXPERT开发软件
9.1 概述
9.2 原理图输入法
9.3 编译与仿真
9.4 ABEL语言与原理图混合输入法
9.5 VHDL输入和Verilog HDL输入
9.6 另一种仿真工具Modelsim的使用
9.7 一些问题的进一步说明
第10章 在系统可编程模拟器件(ispPAC)的开发设计软件
10.1 原理图输入时ispPAC的内部可组态电路
10.2 ispPAC的编程设计组态
10.2.1 ispPAC的增益设置方法
10.2.2 滤波器的设计
10.3 PAC-Designer开发软件的使用
10.3.1 PAC-Designer软件的安装
10.3.2 PAC-Designer软件的使用方法
10.4 ispPAC80/81器件的开发设计
第11章 ispGDX开发系统
11.1 GDF文件的语法
11.1.1 GDF文件的结构框架
11.1.2 GDF句法
11.2 ispGDX开发系统
第12章 ISP DOWNLOADTM下载电缆、ISP实验开发装置及编程下载
12.1 ISP DOWNLOADTM下载电缆
12.2 ISP实验与开发装置
12.2.1 开发装置的技术内容
12.2.2 在系统可编程ISPLDES实验开发装置的实验开发功能
12.3 在系统编程的方法与编程下载
12.3.1 在系统编程各种产品的方法
12.3.2 通常的在系统编程下载
12.3.3 较多器件时的编程下载
12.3.4 器件内容的读出与器件加密
第13章 设计应用实例
13.1 ispLSI设计实例
13.2 ispGDX设计实例
13.3 ispPAC设计实例
13.4 系统设计与实验验证
参考文献

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